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Mentor Graphics QuestaSim2020破解版

 v2020.1
  • 软件大小:792MB
  • 更新日期:2021-01-07
  • 软件语言:简体中文
  • 软件类别:编程开发
  • 软件授权:免费版
  • 软件官网:
  • 适用平台:PC
  • 软件推广:无推广

推荐理由:是一款功能强大的高级仿真模拟软件

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Mentor Graphics QuestaSim2020破解版 手机扫描下载

软件介绍人气软件网友评论下载地址

为您推荐:编程开发

小编今天给大家带来的QuestaSim 2020是一款备受好评并且功能十分强大的高级仿真模拟工具软件,我们软件很好的给想要学习 ic 验证的新人提供了很多帮助,我们软件中不仅是唯一的单核支持 VHDL 和 Verilog 混合仿真的仿真器,也是电子设计自动化(EDA)的技术领导者,提供了全面的软件和硬件设计解决方案,从而可以使公司更快,更好地开发更优质的电子产品。软件可以为广大用户提供高质量的调试环境,旨在让广大用户可以轻松的实现调试工作。利用这个软件,用户可以自由灵活的创建工作和资源库、编译设计、优化设计、加载设计以进行仿真、模拟设计以及进行调试设计等等操作,并且还支持 GUI 模式,命令行模式和批处理模式,这也用户就可以很方便把调试程序与 Questa SIM 进行交互处理,实现工作的最优化。这对于一些想要学习 ic 验证的新人来说不论是在功能上还是在上手难易程度上都是最合适的,非常适合新手来练手,当然老手也可以使用这款软件,我们软件拥有直接优化的编译技术、Tcl/Tk 技术、和单一内核仿真技术,而且编译仿真速度快,编译的代码与平台无关,便于保护 IP 核,个性化的图形界面和用户接口,为用户加快调错提供强有力的手段。
小编这里给大家带来的是 QuestaSim 2020 破解版,附带破解补丁以及详细的安装破解图文教程,帮助不会破解的朋友们完成软件的破解,欢迎感兴趣的朋友们前来下载体验!
QuestaSim2020 破解版

QuestaSim 破解教程

1、在本站下载并解压,得到 QuestaSim 2020 原文件和破解补丁,如图所示

2、首先运行“questasim-win64-2020.1.exe”安装软件,按默认路径安装即可

3、选择同意条款,然后等待安装完成

4、安装完成后退出引导,注意:这一步不要安装 Key Driver

5、将 crack 破解补丁中所有的文件复制到软件根目录下,如图所示
默认路径:C:\questasim64_2020.1

6、运行 MentorKG.exe 和 patch64_dll.bat,得到 license.txt 文件

7、至此,QuestaSim 2020 破解版软件成功破解,运行即可免费使用

软件功能

1、适用于最复杂的回归套件的高性能多语言引擎
2、高效的高级验证解决方案,具有验证管理功能,可覆盖大型复杂电子系统的覆盖范围
3、通过本机断言和完整的多抽象和多语言调试环境(包括事务级调试),易于使用,快速调试
4、约束随机刺激生成以自动化测试开发
5、具有 OVM 和 UVM 的本机高级 SystemVerilog 测试平台功能与独特的调试功能相结合,可简化高级测试平台的开发和调试
6、高带宽事务级(TBX)与 Veloce 平台的集成,可实现显着的仿真加速
7、使用 UPF 对 Power Aware Simulation 进行原生支持
8、多核仿真,支持所有设计语言和构造,并自动或手动分区设计以并行运行,同时维护单个数据库以进行调试和覆盖

软件特色

1、将高性能和容量仿真与高级调试和功能覆盖功能相结合,为 Verilog,VHDL,SystemC 和 UPF 等提供全面的本机支持。
2、通过非常积极的全球编译以及 VHDL 和 SystemVerilog 的仿真优化算法,实现了行业和容量的领先性能。
3、提供全面的,基于标准的 ABV 解决方案,从而提供 SystemVerilog 和属性规范语言的选择。
4、获得了 Questa 验证库(QVL),这是一个完整的 SystemVerilog 断言检查器和监视库,可以很容易地采用 ABV。
5、配备高性能,多语言引擎,适用于大多数复杂的回归套件。
6、与 Veloce 平台进行高带宽事务级集成,以实现显着的模拟加速。
7、通过使用 UPF 获得 Power Aware Simulation 的原生支持。

新功能

1、改进了 SystemVerilog 性能,语法支持,扩展
2、改进的 VHDL 性能默认值
3、改进的 SystemC 2.3.2 支持和默认
4、Visualizer 调试高性能和高容量(VIS)
5、覆盖率-自适应排除,多位表达式,FSM,切换改进
6、覆盖范围-现在默认使用 10.7x 的新报告开关
7、不再支持旧版-novopt 选项
8、可视化工具调试高性能和大容量(VIS)

QuestaSim 使用教程

一、创建工作设计库
在模拟设计之前,必须首先创建一个库并将源代码编译到该库中。
程序
创建一个新目录,并将本课程的设计文件复制到其中。
首先为该练习创建一个新目录(以防其他用户使用这些课程)。
Verilog:将 counter.v 和 tcounter.v 文件从/<install_dir>/examples/tutorials/verilog/basicSimulation 复制到新目录。
VHDL:将 counter.vhd 和 tcounter.vhd 文件从/<install_dir>/examples/tutorials/vhdl/basicSimulation 复制到新目录。
如有必要,启动 Questa SIM。
在 UNIX Shell 提示符下键入 vsim 或在 Windows 中使用 Questa SIM 图标。
首次打开 Questa SIM 后,您将看到“欢迎使用 Questa SIM”对话框。单击关闭。
选择文件>更改目录,然后更改为您在步骤 1 中创建的目录。
创建工作库。
选择文件>新建>库。
这将打开一个对话框,您可以在其中指定库的物理名称和逻辑名称。您可以创建新库或映射到现有库。我们将做前者。
在库名称字段中输入 work(如果尚未自动输入)。
单击确定。
Questa SIM 创建一个名为 work 的目录,并将一个名为 _info 的特殊格式的文件写入该目录。_info 文件必须保留在目录中,以将其区分为 Questa SIM 库。不要从操作系统中编辑文件夹内容;所有更改都应在 Questa SIM 中进行。
Questa SIM 还将库添加到“库”窗口,并在 Questa SIM 初始化文件(modelsim.ini)中记录库映射以供将来参考。
当您在上面的步骤 3c 中按确定时,以下内容被打印到“成绩单”窗口中:
vlib 工作
vmap 工作
这两行是您所做菜单选择的等效命令行。许多等效的命令行将以这种方式回显其菜单驱动的功能。
二、编译设计单元
建工作库后,就可以编译源文件了。
您可以使用图形界面的菜单和对话框来编译源文件,如下面的 Verilog 示例所示,或者在 Questa SIM>提示符下输入命令。
程序
编译 counter.v 和 tcounter.v。
选择编译>编译。这将打开“编译源文件”对话框。
如果“编译”菜单选项不可用,则可能已打开一个项目。如果是这样,请通过激活“库”窗口并从菜单中选择“文件”>“关闭”来关闭项目。
从“编译源文件”对话框中选择 counter.v 和 tcounter.v 模块,然后单击“编译”。这些文件被编译到工作库中。
编译完成后,单击“完成”。
查看编译的设计单位。
在“库”窗口中,单击工作库旁边的“+”图标,您将看到两个设计单元。您还可以查看其类型(模块,实体等)以及基础源文件的路径。

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提取码:提取码:91rz
               

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